Verilog HDL实用教程

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Verilog HDL实用教程
        本教材介绍在专用集成电路（ASIC：Application Specified Integrated Circuit）设计领域应用最广的硬件描述语言Verilog HDL。掌握这种语言后，可以像编制一个软件程序一样对一个电子系统的结构或功能进行描述，通过功能仿真、逻辑综合、版图综合、时序验证等一系列后续工作，借助电子设计自动化EDA（Electronic Design Automation）工具，最终完成电子系统的硬件实现（IC芯片或FPGA等）。
        本教材主要面向有一定逻辑设计基础与程序设计经验的电子类高年级本科生或研究生，同时也是一本电子类设计从业人员必备的工程参考书。

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[ 本帖最后由 dingdong 于 2008-8-22 23:10 编辑 ]